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多相并行FIR滤波器的FPGA高速实现方法

FPGA Implementation of Polyphase Parallel FIR Filter

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【作者】 张娜李春祎

【Author】 ZHANG Na;LI Chun-yi;The 54th Research Institute of CETC;Hebei College of Industry and Technology;

【机构】 中国电子科技集团公司第五十四研究所河北工业职业技术学院

【摘要】 L路多相并行FIR滤波器的工作速率是单路串行FIR滤波器的L倍,基于多项式分解的多相并行FIR滤波器实现结构简单、计算复杂度小、滤波运算延迟少;针对多相并行FIR滤波器,给出了基于多项式分解的多相并行FIR滤波器优化实现结构的FPGA高速实现方法。归纳、整理和推导了2路至8路基于多项式分解的多相并行滤波器优化实现结构,并针对FPGA实现的具体特点给出了多相并行滤波器优化实现结构的FPGA高速实现方法。通过测试分析可知,给出的基于多项式分解的多相并行FIR滤波器优化实现结构的FPGA高速实现方法能够在FPGA上高速实现多相并行FIR滤波器。

【Abstract】 Compared with the serial FIR filter,the sample frequency of L-channel polyphase parallel FIR filter is increased by a factor of L.The implementation structure of polyphase parallel filter based on polynomial decomposition is simple,with low computation complexity and short delay.The paper summarizes and deduces the optimal structure of polyphase parallel filter from 2 channels to 8channels.Further,the paper proposes the implementation method of the optimal structure of polyphase parallel filter fit for processing in FPGA.The computer simulation shows the proposed implementation method of polyphase parallel filter is fit for processing in FPGA with high-speed.

【关键词】 FIR滤波器多相分解FPGA高速
【Key words】 FIR filterpolyphase decompositionFPGAhigh-speed
【基金】 中国电子科技集团公司航天信息应用技术重点实验室开放基金(EX166290012)
  • 【文献出处】 无线电通信技术 ,Radio Communications Technology , 编辑部邮箱 ,2017年04期
  • 【分类号】TN713
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